在我目前正在进行的设计中,我需要四端口柱塞。然而,在查找表中实现它是使用大量的区域,我无法通过该设置达到所需的性能。既然,我的FPGA有单端口和双端口RAM的硬件模块,那么我可以将它们组合成四端口存储器吗?
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您可以考虑对Block RAM进行双重计时,尽管这会影响时序等。
参见例如http://www.xilinx.com/support/documentation/application_notes/xapp228.pdf
如果你只需要四读访问,那么你只需要两个双端口Block RAM,它们都连接到相同的写使能和写数据。