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自下而上的分层合成?
时间:2017-10-26 15:51:45
标签:
verilog
yosys
如果不修改输入verilog(RTL),如何与Yosys进行自下而上的同步?即从叶子模块开始,一路走到顶端。目的是(很差)合成一个大型设计并获得区号。
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