电路中的传播延迟

时间:2017-08-01 10:01:54

标签: circuit vlsi asic

这对于准确的比例延迟更好:spice模拟方法或使用elmores延迟计算(RC延迟建模)

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Spice模拟比elmore延迟建模更准确。 Weste Harris在第93页第2.6节“CMOS VLSI设计”一书中提到了这一点

  

盲目地信任一个人的模特   模型应该被视为对现实的近似,而不是现实本身,并在其中使用   他们的局限。特别是像Shockley或RC模型这样的简单模型甚至都不是很接近   准确地适应现代晶体管的I-V特性。它们对于它们很有价值   他们对趋势的洞察力(即,使晶体管更宽,增加其栅极电容和   降低其导通电阻,而不是他们预测的绝对值。尖端项目   通常针对仍处于开发阶段的流程,因此这些模型应该只是   被视为投机。最后,过程可能无法完全体现所有运作机制;   例如,不要假设您的模型在亚阈值区域中是准确的   除非您的供应商告诉您。说到这里,现代SPICE模型做得非常好   将性能预测到GHz范围的工作,以便进行充分表征的过程和   使用适当的设计实践时的模型(例如考虑温度,电压和温度)   过程变异)。