设计架构时遇到问题(原理图)

时间:2015-04-07 15:41:01

标签: fpga boolean-logic computer-architecture digital-logic

好的,所以我目前正在进行数字逻辑设计课程,我对本周被要求做的设计感到困惑。 我们被告知要设计一个可以根据命令执行以下功能的架构(DataPath +控件)。

我假设它将成为具有几个先决条件的所有原理图。

3个功能是

 1. Z = A + B 
 2. Z = A & B (as in like bitwise AND)
 3. Z= 1 if A < B and 0 if A > B

我们被告知假设A和B是输入,Z是输出,并假设所有输入都是4位。

有两件事令我困惑。一个是如果它在同一个原理图上那么它将是三个不同的功能。在A或B之后,Z会不会很高?第二,你如何做不平等?你会像移位寄存器一样使用一系列拖鞋吗?

1 个答案:

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必须有一个多路复用器来选择输出三个功能中的哪一个,一次只能输出一个功能(因为只有一个输出),但是你可以选择要执行的功能。这需要电路的另一个输入来控制多路复用器。

不平等是用比较器来处理的。您没有指定用于设计电路的工具,但我猜测原理图输入。在这种情况下,它的标准库中应该有比较器。

在旁注中,与减法者相比,即A-B为负数,而不是A>B,否则为B>=A